目录

一、基于门电路设计D触发器

1.创建工程

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2.设计门电路

电路元件：4个and2 ，1个not，2个input，2个output
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3.编译仿真

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编译通过

创建vwm格式波形文件
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选中CLK产生时钟信号
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鼠标选中D，Q信号Q-n进行编辑
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时序波形仿真
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二、调用Quartus-II中D触发器电路

新建原理图文件：
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直接使用D触发器：
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进项仿真
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三、基于Verilog语言实现D触发器

创建Verilog文件：
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编写Verilog代码：

module D_Trigger(d,clk,q);
    input d,clk;
    output q;
    reg q;

    always @ (posedge clk)
		if(clk)
        q <= d;
endmodule

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仿真：
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参考

https://blog.csdn.net/ssj925319/article/details/115355019

# fpga开发 # 硬件架构
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